JEDEC kündigt neuen SPHBM4-Standard an: KI-Speicherkosten sinken
Die Organisation JEDEC hat den neuen SPHBM4-Standard (JESD330-4) veröffentlicht, der durch ein schmaleres 512-Bit-Interface und die Nutzung kostengünstiger organischer Substrate die Herstellung von HBM4-Speichern ohne teure fortschrittliche Verpackungstechnologien ermöglicht. Mit einer maximalen Bandbreite von 2,944 Terabyte pro Sekunde in einem Modul bietet dieser Standard eine leistungsfähige Alternative für Hersteller, die keinen Zugang zu Silizium-Intersubstrate-Linien haben, und soll die Abhängigkeit äten verringern.
Kurzfassung
Warum das wichtig ist
- Die Organisation JEDEC hat den neuen SPHBM4-Standard (JESD330-4) veröffentlicht, der durch ein schmaleres 512-Bit-Interface und die Nutzung kostengünstiger organischer Substrate die Herstellung von HBM4-Speichern ohne teure fortschrittliche Verpackungstechnologien ermöglicht.
- Mit einer maximalen Bandbreite von 2,944 Terabyte pro Sekunde in einem Modul bietet dieser Standard eine leistungsfähige Alternative für Hersteller, die keinen Zugang zu Silizium-Intersubstrate-Linien haben, und soll die Abhängigkeit äten verringern.
- JEDEC hat den Standard SPHBM4 (Standard Package High Bandwidth Memory) veröffentlicht, um die in Beschleunigern für künstliche Intelligenz eingesetzte hochpreisige HBM-Speichertechnologie kostengünstiger zu gestalten.
SvyTech-Check
Redaktionelle Einordnung
Kernpunkt
Mit einer maximalen Bandbreite von 2,944 Terabyte pro Sekunde in einem Modul bietet dieser Standard eine leistungsfähige Alternative für Hersteller, die keinen Zugang zu Silizium-Intersubstrate-Linien haben,...
Warum relevant
Dieser neue Standard, der unter der Spezifikation JESD330-4 definiert ist, zielt darauf ab, HBM4-Speicherchips mit kostengünstigeren Standardverpackungsmethoden und organischen Substraten zu kombinieren.
Einordnung
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Dieser neue Standard, der unter der Spezifikation JESD330-4 definiert ist, zielt darauf ab, HBM4-Speicherchips mit kostengünstigeren Standardverpackungsmethoden und organischen Substraten zu kombinieren. Dieser Umstand könnte die Abhängigkeit, die eine begrenzte Produktionskapazität aufweisen und mit hohen Kosten verbunden sind.
Neues Interface-Design Die derzeit bei HBM3- und HBM4-Standards eingesetzten breiten Schnittstellen mit 1024 und 2048 Bit erforderten nicht nur einen großen Siliziumbereich auf dem Prozessor, sondern zwangen zudem den Einsatz kostspieliger Zwischenschichten. SPHBM4 überwindet diese Hürde durch ein schmaleres externes Interface mit einer Breite von 512 Bit.
Um den durch das schmale Interface verursachten Bandbreitenverlust auszugleichen, werden Datenübertragungsraten zwischen 22,4 und 46 Gigatransfers pro Sekunde unterstützt.
Technischer Hintergrund
Quad-Channel-Technologie Im Speicherbaugruppierung werden 32 interne Kanäle mit jeweils 64 Bit Breite zu vierfach gruppierten Einheiten zusammengeführt und in acht Quad-Channel-Strukturen umgewandelt.
Quellenprofil
Quelle und redaktionelle Angaben
- Quelle
- tomshardware.com
- Canonical
- https://svytech.de/artikel/jedec-kundigt-neuen-sphbm4-standard-an-ki-speicherkosten-sinken
- Quell-URL
- https://www.tomshardware.com/pc-components/dram/jedec-releases-new-sphbm4-standard-to-slash-ai-memory-costs-narrow-512-bit-interface-enables-dropping-expensive-interposers-for-organic-substrates
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